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高速・高精度信号処理集積システム

通信,制御,マルチメディアサービス等の高度化を支える高速・高品位信号処理システムの理論と自動合成について研究を行う.特に VLSI/DSP 実現を前提とした計算精度・計算速度最適化,処理要求に対する VLSI/DSP 実現時の性能を最適化する高速算法・緩和算法の自動生成の確立を目指している.

耐故障集積システム

超並列計算機構を VLSI/WSI 上に実装し,高い信頼性を持って動作させるための,故障検出・救済,誤り検出・訂正について,システム再構成,アルゴリズム冗長の立場から検討を進める.これらに関する要素理論・技術の確立を目指すとともに,訂正と再構成に関する統一理論を目標としている.一方,具体的アプリケーションに即し,アルゴリズムレベルから回路レベルまでの冗長性を最適化する,耐故障計算処理システムの高位合成論と計算機支援設計についても研究を行う.

集積回路システムの設計自動化に関する研究

論理系集積システムに関して,論理合成からテクノロジーマッピングのフェーズを一貫して最適化を行う完全自動設計のための理論と設計システムの構築を行う.また,非線形連続時間系についてのシステム理論,最適化論,自動合成論についても検討を行っている.

集積回路システムに対するテスト技術

半導体ロードマップ(ITRS '01)によると,集積回路の大規模化・高速化に伴って,集積回路の全コストに対するテストコストの割合が今後ますます増加していくと予想されている.この状況を打破するためには,テスト技術におけるブレークスルーが不可欠である.我々は効率的なテストを行うためのテスト技術(テスト生成,テスト容易化設計,テスト容易化合成等)について検討を行っている.


Kaneko Lab. | School of Information Science | JAIST
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Last-modified: 2007-04-04 (Wed) 15:05:56 (6253d)